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AS4C128M32MD2A-25BINTR

Name: Alliance Memory AS4C128M32MD2A-25BINTR
Brand: Alliance Memory
SKU: 913-4C12832MD2A25BIT
Price: 9.69 CHF
Availability: OutOfStock

Bilder dienen lediglich der Veranschaulichung und sind nicht Originalgetreu
Siehe Produktspezifikationen

Mouser-Nr.:

913-4C12832MD2A25BIT

Herst.- Nr.:

AS4C128M32MD2A-25BINTR

Herst.:

Alliance Memory

Beschreibung:

DRAM LPDDR2, 4G, 128M X 32, 1.2V, 134 BALL BGA, 400MHZ, Industrial TEMP - Tape & Reel

Datenblatt:

AS4C128M32MD2A-25BINTR Datenblatt (PDF)

ECAD Model:

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Hersteller:	Alliance Memory
Produktkategorie:	DRAM
RoHS:
Typ:	SDRAM Mobile - LPDDR2
Speichergröße:	4 Gbit
Datenbus-Weite:	32 bit
Maximale Taktfrequenz:	400 MHz
Verpackung/Gehäuse:	FBGA-134
Organisation:	128 M x 32
Zugangszeit:	5.5 ns
Versorgungsspannung - Min.:	1.14 V
Versorgungsspannung - Max.:	1.95 V
Minimale Betriebstemperatur:	- 40 C
Maximale Betriebstemperatur:	+ 85 C
Serie:	AS4C128M32MD2A-25
Verpackung:	Reel
Marke:	Alliance Memory
Feuchtigkeitsempfindlich:	Yes
Montageart:	SMD/SMT
Produkt-Typ:	DRAM
Verpackung ab Werk:	2000
Unterkategorie:	Memory & Data Storage
Versorgungsstrom - Max.:	130 mA

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Datenblatt

AS4C128M32MD2A-25BINTR Datenblatt (PDF)

REACH Declaration (PDF)

Konformitätscodes

CAHTS:: 8542320020
USHTS:: 8542320036
MXHTS:: 8542320201
ECCN:: EAR99

Ursprungsklassifikationen

Ursprungsland:: Taiwan
Herstellungsland:: Taiwan
Land der Verbreitung:: Taiwan

Zum Zeitpunkt der Lieferung kann sich das Land ändern.

Stromsparender DDR2-SDRAM

Alliance stromsparende DDR2-SDRAM-Speicher sind Hochgeschwindigkeits-CMOS- und Dynamic-Access-Speicher, die intern als 8-Bank-Speicher konfiguriert sind. Diese DDR2-SDRAM verfügen über 4-Bit-Prefetch-DDR-Architektur, programmierbare Lese- und Schreib-Latenzen, automatische temperaturkompensierte Selbstauffrischung (TCSR) und Taktstopp-Fähigkeit. Der DDR2-SDRAM reduziert die Anzahl der Eingangspins im System durch Verwendung einer Architektur mit doppelter Datenrate auf dem Befehls-/Adressbus (CA-Bus). Diese CA-Bus dient zur Übertragung von Adress-, Befehls- und Bankdaten. Dieser DDR2-SDRAM kann einen Hochgeschwindigkeitsbetrieb erreichen, indem eine Architektur mit doppelter Datenrate an den DQ-Pins (bidirektionaler/differenzieller Datenbus) verwendet wird.