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LS1012ASN7KKB

Name: NXP LS1012ASN7KKB
Brand: NXP Semiconductors
SKU: 771-LS1012ASN7KKB
Price: 30.56 CHF
Availability: InStock

Bilder dienen lediglich der Veranschaulichung und sind nicht Originalgetreu
Siehe Produktspezifikationen

Mouser-Nr.:

771-LS1012ASN7KKB

Herst.- Nr.:

LS1012ASN7KKB

Herst.:

NXP Semiconductors

Beschreibung:

Mikroprozessoren - MPU LS1012A - ST PFE GbE PCIe SATA 1G R2

Datenblatt:

LS1012ASN7KKB Datenblatt (PDF)

ECAD Model:

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	CHF 30.56	CHF 30.56
	CHF 24.83	CHF 248.30
	CHF 22.67	CHF 566.75
	CHF 20.89	CHF 3’509.52
	CHF 20.87	CHF 10’518.48
1’008	Kostenvoranschlag

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Produktattribut	Attributwert	Attribut auswählen
Hersteller:	NXP
Produktkategorie:	Mikroprozessoren - MPU
Versandbeschränkungen:	Für den Export dieses Produkts aus den USA ist möglicherweise zusätzliche Dokumentation erforderlich.
RoHS:
Kern:	ARM Cortex A53
Anzahl der Kerne:	1 Core
Datenbus-Weite:	64 bit
Maximale Taktfrequenz:	1 GHz
Verpackung/Gehäuse:	VFLGA-211
L1 Cache-Anweisungsspeicher:	32 kB
L1 Cache-Datenspeicher:	32 kB
Betriebsversorgungsspannung:	900 mV
Serie:	LS1012A
Montageart:	SMD/SMT
Minimale Betriebstemperatur:	0 C
Maximale Betriebstemperatur:	+ 105 C
Verpackung:	Tray
Marke:	NXP Semiconductors
RAM-Datengröße:	128 kB
Anleitungsart:	Floating Point
Schnittstellen-Typ:	I2C, I2S, JTAG, SDIO, SPI, UART
L2 Cache-Anweisung/Datenspeicher:	256 kB
Speichertyp:	DDR3L
Feuchtigkeitsempfindlich:	Yes
Produkt-Typ:	Microprocessors - MPU
Verpackung ab Werk:	168
Unterkategorie:	Microprocessors - MPU
Handelsname:	QorIQ
Watchdog-Timer:	Watchdog Timer
Artikel # Aliases:	935357527557

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Datenblatt

LS1012ASN7KKB Datenblatt (PDF)

Konformitätscodes

CNHTS:: 8542319091
CAHTS:: 8542310000
USHTS:: 8542310030
TARIC:: 8542319000
ECCN:: 3A991.a.1

Ursprungsklassifikationen

Ursprungsland:: Taiwan
Herstellungsland:: Taiwan
Land der Verbreitung:: Taiwan

Zum Zeitpunkt der Lieferung kann sich das Land ändern.

QorIQ LS1012A Stromsparender Kommunikationsprozessor

Der NXP QorIQ LS1012A stromsparende Kommunikationsprozessor ist für batteriegestützte oder über USB-versorgte Netzwerk- und IoT-Applikationen mit begrenztem Platz optimiert. Der LS1012A Prozessor integriert einen einzelnen ARM Cortex-A53-Core mit bis zu 800 MHz mit L1- und ECC-geschützten L2-Caches. Das Bauteil enthält die gleiche Trust-Architektur und Softwarekompatibilität wie die Bauteile der höherrangigen QorIQ LS-Produktfamilie. Der LS1012A-Prozessor verfügt über einen 32 KB L1-Befehls- und Daten-Cache und 256 KB kohärentem L2-Cache. Dieses Bauteil verfügt über einen Multi-Protokoll-SerDes mit drei Lanes von 6 GHz, der Schnittstellen mit hoher Geschwindigkeit unterstützt. Unterstützt werden bis zu zwei Gigabit Ethernet-Anschlüsse, ein DMA-gesteuerter PCI Express®-Anschluss der Generation 2.0 und ein SATA-3.0-Anschluss. Der LS1012A verfügt auch über doppelte USB-Controller - einer unterstützt SuperSpeed USB 3.0 mit integrierter PHY, der andere Funktionen von USB 2.0. Zusätzliche Schnittstellen umfassen QuadSPI und Unterstützung für SD/MMC. Dieser Prozessor bietet intelligente Integration und extreme Leistungseffizienz in einem kleinen 9,6x9,6mm-Gehäuse für lüfterlose Netzwerk- und IoT-Applikationen mit kleiner Baugröße.

Layerscape-Architektur

Die NXP Layerscape-Architektur ist die den QorIQ® Prozessoren der LS-Baureihe zugrundeliegende Systemarchitektur. Die Architektur ermöglicht den Netzwerken der nächsten Generation eine verbesserte Paketverarbeitung mit einer Leistungsfähigkeit von bis zu 100 GBit/s. Der Design-Aufwand wird mit einem offenen Standard-Programmiermodell und einem Software-wahrnehmenden Architektur-Rahmen vereinfacht. Dieses Design ermöglicht dem Kunden die vollständige Nutzung der zugrundeliegenden Hardware für eine maximale Optimierung mit der Fähigkeit, Netzwerk-Änderungen für eine Echtzeit-„Soft“-Steuerung über das Netzwerk einfach zu übernehmen. Ein einheitliches Hardware- und Software-Modell bietet die Kompatibilität und Skalierbarkeit, die für das Erstellen von durchgängigen Netzwerksystemen von Home-zu-Carrier-Klasse-Produkten erforderlich sind. Die einzigartige Core-unabhängige Architektur enthält den optimalen Core für die jeweilige Applikation/ARM®-Cores oder Power Architecture®-Cores.