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TMS320VC5501ZZZ300

Bilder dienen lediglich der Veranschaulichung und sind nicht Originalgetreu
Siehe Produktspezifikationen

Mouser-Nr.:

595-S320VC5501ZZZ300

Herst.- Nr.:

TMS320VC5501ZZZ300

Herst.:

Texas Instruments

Beschreibung:

Digitale Signalprozessoren und Controller - DSP, DSC Fixed-Pt Dig Signal Proc

Lebenszyklus:

abgekündigt

Datenblatt:

TMS320VC5501ZZZ300 Datenblatt

ECAD Model:

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Versandmeldung:

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Hersteller:	Texas Instruments
Produktkategorie:	Digitale Signalprozessoren und Controller - DSP, DSC
Versandbeschränkungen:	Mouser verkauft dieses Produkt nicht in Ihre Region.
RoHS:
Produkt:	DSPs
Kern:	C55x
Anzahl der Kerne:	1 Core
Maximale Taktfrequenz:	300 MHz
Verpackung/Gehäuse:	BGA-201 Microstar
Programmspeichergröße:	32 kB
RAM-Datengröße:	32 kB
L1 Cache-Anweisungsspeicher:	16 kB
Betriebsversorgungsspannung:	1.26 V
Serie:	TMS320VC5501
Handelsname:	TMS320
Montageart:	SMD/SMT
Minimale Betriebstemperatur:	- 40 C
Maximale Betriebstemperatur:	+ 85 C
Verpackung:	Tray
Marke:	Texas Instruments
Land der Bestückung:	Not Available
Land der Verbreitung:	Not Available
Ursprungsland:	PH
Datenbus-Weite:	32 bit
ROM-Datengröße:	32 kB
Anleitungsart:	Fixed Point
Feuchtigkeitsempfindlich:	Yes
Anzahl der I/Os:	8 I/O
Produkt-Typ:	DSP - Digital Signal Processors & Controllers
Art des Programmspeichers:	Asynchronous SRAM, EPROM, Synchronous SDRAM, SBSRAM
Verpackung ab Werk:	126
Unterkategorie:	Embedded Processors & Controllers
Gewicht pro Stück:	479.700 mg

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Datenblatt

TMS320VC5501ZZZ300 Datenblatt

Application Notes

EOL

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TMS320VC5501 Digitaler Festpunkt-Signalprozessor

Der Texas Instruments TMS320VC5501 digitale Festpunkt-Signalprozessor (DSP) basiert auf dem TMS320C55x DSP-Generierungs-CPU-Prozessorkern. Die TMS320C55x DSP-Architektur von Texas Instruments erreicht eine hohe Leistungsfähigkeit bei geringem Stromverbrauch, der durch erhöhte Parallelität und starken Fokus auf die Reduzierung der Verlustleistung erzielt wird. Die CPU unterstützt eine interne Busstruktur, die aus einem Programmbus, drei Lese-Datenbusse, zwei Schreib-Datenbusse und weiteren Bussen für Peripherie- und DMA-Aktivitäten besteht. Diese Busse bieten in einem einzigen Zyklus die Möglichkeit bis zu drei Datenlesungen und zwei Datenschreibungen auszuführen. Der DMA-Controller kann bis zu zwei Datenübertragungen pro Zyklus parallel und unabhängig von der CPU-Aktivität durchführen.