TMS320VC5510AZAVA1

Texas Instruments
595-S320VC5510AZAVA1
TMS320VC5510AZAVA1

Herst.:

Beschreibung:
Digitale Signalprozessoren und Controller - DSP, DSC Fixed-Point Digital Signal Processors 24

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CHF 24.04 CHF 6'058.08

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Texas Instruments
Produktkategorie: Digitale Signalprozessoren und Controller - DSP, DSC
RoHS:  
DSPs
C55x
1 Core
160 MHz
BGA-240
352 kB
256 kB
24 kB
1.6 V
TMS320VC5510A
SMD/SMT
- 40 C
+ 85 C
Tray
Marke: Texas Instruments
ROM-Datengröße: 32 kB
I/O-Spannung: 3.3 V
Anleitungsart: Fixed Point
Feuchtigkeitsempfindlich: Yes
Anzahl der Timer/Zähler: 2 Timer
Produkt-Typ: DSP - Digital Signal Processors & Controllers
Verpackung ab Werk: 126
Unterkategorie: Embedded Processors & Controllers
Versorgungsspannung - Max.: 1.65 V
Versorgungsspannung - Min.: 1.55 V
Watchdog-Timer: No Watchdog Timer
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Ausgewählte Attribute: 0

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CNHTS:
8542319090
USHTS:
8542310035
TARIC:
8542319000
ECCN:
3A991.a.2

Prozessoren

Texasinstruments Prozessoren bieten ein umfassendes Portfolio, bewährte Software und weltweite Unterstützung und ermöglichen branchenführende Lösungen in der Automobilindustrie und der Industrie. TI widmet sich der Entwicklung und Optimierung der Prozessoren von heute, um die Intelligenz, die Leistung und die Kostenanforderungen in Automobil-und Industrieapplikationen von morgen zu erreichen. Skalierbare Hardware-und Software-Plattformen mit gemeinsamen Code ermöglichen Entwicklern die nahtlose Wiederverwendung und die Migration über Geräte hinweg, um die zukünftigen Investitionen zu schützen.

TMS320VC5510A Festpunkt-DSPs

Texas Instruments TMS320VC5510A Digitale Festpunkt-Signalprozessoren basieren auf dem TMS320C55x DSP-Generierungs-CPU-Prozessorkern. Diese Bauteile verfügen über eine C55x™-DSP-Architektur, die eine hohe Leistungsfähigkeit und einen geringen Stromverbrauch durch erhöhte Parallelität und einen vollständigen Fokus auf die Reduzierung der Verlustleistung erzielt Die CPU unterstützt eine interne Busstruktur, die aus einem Programmbus, drei Lese-Datenbusse, zwei Schreib-Datenbusse und weiteren Bussen für Peripherie- und DMA-Aktivitäten besteht. Diese Busse bieten in einem einzigen Zyklus die Möglichkeit, bis zu drei Datenlesungen und zwei Datenschreibungen auszuführen. Der DMA-Controller kann bis zu zwei Datenübertragungen pro Zyklus parallel und unabhängig von der CPU-Aktivität durchführen.