A3R12E30DBF-8E

Zentel Japan
155-A3R12E30DBF-8E
A3R12E30DBF-8E

Herst.:

Beschreibung:
DRAM DDR2 512Mb, 64Mx8, 800 at CL5, 1.8V, FBGA-60

Datenblatt:
ECAD Model:
Den kostenlosen Library Loader herunterladen, um diese Datei für Ihr ECAD Tool zu konvertieren. Weitere Infos zu ECAD-Modell.
Mehr über
Weitere Informationen zu Zentel Japan A3R12E30DBF-8E

Auf Lager: 63

Lagerbestand:
63 sofort lieferbar
Lieferzeit ab Hersteller:
16 Wochen Geschätzte Produktionszeit des Werks für Mengen, die größer als angezeigt sind.
Bestellmengen größer als 63 können einer Mindestbestellmenge unterliegen.
Minimum: 1   Vielfache: 1
Stückpreis:
CHF -.--
Erw. Preis:
CHF -.--
Vorauss. Zolltarif:

Preis (CHF)

Menge Stückpreis
Erw. Preis
CHF 2.67 CHF 2.67
CHF 2.50 CHF 25.00
CHF 2.42 CHF 60.50
CHF 2.36 CHF 118.00
CHF 2.31 CHF 231.00
CHF 2.23 CHF 557.50
CHF 2.20 CHF 1’100.00
CHF 2.16 CHF 2’160.00
CHF 2.06 CHF 4’985.20

Produktattribut Attributwert Attribut auswählen
Zentel Japan
Produktkategorie: DRAM
RoHS:  
SDRAM - DDR2
512 Mbit
8 bit
400 MHz
FPGA-60
64 M x 8
400 ps
1.7 V
1.9 V
0 C
+ 85 C
DDR2
Tray
Marke: Zentel Japan
Land der Bestückung: Not Available
Land der Verbreitung: Not Available
Ursprungsland: TW
Feuchtigkeitsempfindlich: Yes
Montageart: SMD/SMT
Produkt-Typ: DRAM
Verpackung ab Werk: 2420
Unterkategorie: Memory & Data Storage
Versorgungsstrom - Max.: 65 mA
Handelsname: Zentel Japan
Gewicht pro Stück: 159 mg
Produkte gefunden:
Um ähnliche Produkte anzuzeigen, wählen Sie mindestens ein Kontrollkästchen aus
Um ähnliche Produkte in dieser Kategorie anzuzeigen, wählen Sie mindestens ein Kontrollkästchen oben aus.
Ausgewählte Attribute: 0

Datenblatt

CNHTS:
8542329000
USHTS:
8542320028
ECCN:
EAR99

DDR2 SDRAM

Zentel DDR2 SDRAM features a double-data-rate architecture with two data transfers per clock cycle. The high-speed data transfer is realized by the 4 bits prefetch pipelined architecture. A bi-directional differential data strobe (DQS and /DQS) is transmitted/received with data for capturing data at the receiver. DQS is edge-aligned with data for READs; center-aligned with data for WRITEs Differential clock inputs (CK and /CK). The DLL aligns DQ and DQS transitions with CK transitions.

EMPFOHLENE PRODUKTE
ZENTEL JAPAN

Supplier Image
Alle neuen Produkte von Zentel Japan anzeigen

Ein unerwarteter Fehler ist aufgetreten.


Haben Sie eine Frage? Bitte besuchen Sie das Hilfecenter.
Bei Fragen zu einer bestimmten Bestellung melden Sie sich bitte bei Ihrem Konto an.

Sollten Sie weitere Probleme haben, kontaktieren Sie uns bitte unter 800-346-6873 oder senden Sie eine E-Mail an help@mouser.com.