DK-SI-5SGXEA7N

Altera
989-DK-SI-5SGXEA7N
DK-SI-5SGXEA7N

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Beschreibung:
Programmierbare logische IC-Entwicklungstools FPGA Starter Kit For Stratix V 5SGXEA7

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Altera
Produktkategorie: Programmierbare logische IC-Entwicklungstools
Development Kits
FPGA
5SGXEA7N2F40C2N
Marke: Altera
Beschreibung/Funktion: Stratix V GX development kit
Schnittstellen-Typ: Ethernet, USB
Betriebsversorgungsspannung: 20 V
Produkt-Typ: Programmable Logic IC Development Tools
Serie: Stratix V GX Development Kits
Verpackung ab Werk: 1
Unterkategorie: Development Tools
Handelsname: Stratix V FPGA
Artikel # Aliases: 980300
Gewicht pro Stück: 3.016 kg
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5-0217-03

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CNHTS:
8473309000
CAHTS:
8473302000
USHTS:
8473301180
TARIC:
8473302000
MXHTS:
8473300401
ECCN:
EAR99

SoC FPGA Family

Altera SoC FPGAs integrate an Arm-based hard processor system (HPS) consisting of processors, peripherals, and memory interfaces with the FPGA fabric using a high-bandwidth interconnect backbone. The devices combine the performance and power savings of hard intellectual property (IP) with the flexibility of programmable logic. These user-customizable Arm-based SoC FPGAs are ideal for reducing system power, cost, and board size by integrating discrete processors and digital signal processing (DSP) functions into a single FPGA. They differentiate the end product with custom hardware and software and add support for virtually any interface standard or protocol in the FPGA.

Stratix® Entwicklungstools der FPGA-Serie

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Stratix® V GX Transceiver-Signalqualitäts-Kit

Das Altera Stratix® V GX Transceiver Signal Integrity Development Kit ist eine vollständige Design-Umgebung, die sowohl die Hardware als auch die Software enthält, die zur Entwicklung von Stratix V GX FPGA-Designs benötigt werden. Die einjährige Lizenzvereinbarung für die Quartus® II Software bietet Ihnen alles, was Sie benötigen, um mit der Entwicklung der benutzerdefinierten Stratix V GX FPGA-Designs zu beginnen. Dieses Kit ermöglicht dem Benutzer die Evaluierung der Transceiverleistung von 600 MBit/s bis zu 12,5 GBit/s und die Generierung und Überprüfung der PRBS-Muster (Pseudorandom Binary Sequence, PRBS). Zur Optimierung der Transceiver-Leistung für Kanäle können Designer eine dynamische Änderung der Differential-Ausgangsspannungs- (VOD), Vorverzerrungs- und Entzerrungseinstellungen durchführen. Das Kit ermöglicht die Durchführung von Jitter-Analysen. Der Benutzer kann die PMA-Compliance (PMA = physikalischer Medienzugang) nach PCI Express® (PCIe®), GBit/s-Ethernet (GbE), XAUI, CEI-6G, Serial RapidIO®, serieller Digitalschnittstelle mit hoher Auflösung (HD-SDI) und anderen wichtigen Standards verifizieren.

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