Clock-Synthesizer / Jitter-Reiniger

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Menge RoHS ECAD Model Anzahl der Ausgänge
Max. Ausgangsfrequenz
Ausgangsstufe
Eingabestufe
Verpackung/Gehäuse
Versorgungsspannung - Min.
Versorgungsspannung - Max.
Minimale Betriebstemperatur
Maximale Betriebstemperatur
Montageart
Verpackung
Analog Devices Clock-Synthesizer / Jitter-Reiniger Dual DPLL Digitized Clock Synchronizer
Datenblatt
636Auf Lager
Min.: 1
Mult.: 1

10 Output 500 MHz CML, HCSL, LVDS Differential, Single-Ended LFCSP-48 1.7 V 1.89 V - 40 C + 85 C SMD/SMT Tray
Analog Devices Clock-Synthesizer / Jitter-Reiniger Jitter clean +/PPS + Small Cell Clock
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 10 Wochen
Min.: 750
Mult.: 750
Rolle: 750

10 Output 500 MHz CML, HCSL, LVDS Differential, Single-Ended LFCSP-48 1.7 V 1.89 V - 40 C + 85 C SMD/SMT Reel