SN74SSTU32864NMJR

Texas Instruments
595-N74SSTU32864NMJR
SN74SSTU32864NMJR

Herst.:

Beschreibung:
Taktsignalpuffer 500-MHz 25-bit conf igurable registered

ECAD Model:
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Erw. Preis:
CHF -.--
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Gehäuse:
Ganzes Reel (Sie bestellen ein Vielfaches von 1000)

Preis (CHF)

Menge Stückpreis
Erw. Preis
Gurtabschnitt / MouseReel™
CHF 15.86 CHF 15.86
CHF 12.67 CHF 126.70
CHF 11.87 CHF 296.75
CHF 10.99 CHF 1'099.00
CHF 10.57 CHF 2'642.50
CHF 10.32 CHF 5'160.00
Ganzes Reel (Sie bestellen ein Vielfaches von 1000)
CHF 10.04 CHF 10'040.00
2'000 Kostenvoranschlag
† Für die MouseReel™ wird Ihrem Warenkorb automatisch eine Gebühr von CHF 7.00 hinzugefügt. MouseReel™ Bestellungen sind weder stornierbar, noch können sie zurückgegeben werden.

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Texas Instruments
Produktkategorie: Taktsignalpuffer
RoHS:  
25 Output
500 MHz
2.7 ns
SSTL-18
NFBGA-96
SSTL-18
500 MHz
1.7 V
1.9 V
SN74SSTU32864
0 C
+ 70 C
Marke: Texas Instruments
Feuchtigkeitsempfindlich: Yes
Montageart: SMD/SMT
Verpackung: Reel
Verpackung: Cut Tape
Verpackung: MouseReel
Produkt: Clock Buffers
Produkt-Typ: Clock Buffers
Verpackung ab Werk: 1000
Unterkategorie: Clock & Timer ICs
Typ: 25-Bit Configurable Registered Buffer
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Ausgewählte Attribute: 0

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USHTS:
8542390090
ECCN:
EAR99

SN74SSTU32864 Konfigurierbarer registrierter Buffer

Der Texas Instruments SN74SSTU32864 konfigurierbare registrierte 25-Bit-Buffer ist ein konfigurierbarer registrierter 25-Bit-1:1- oder 14-Bit-1:2-Buffer, der für einen VCC-Betrieb von 1,7 V bis 1,9 V ausgelegt ist. Die 1:1-Pinbelegungskonfiguration erfordert lediglich ein Bauteil pro DIMM zur Ansteuerung von neun SDRAM-Lasten. Die 1:2-Pinbelegungskonfiguration erfordert zwei Bauteile pro DIMM zur Ansteuerung von 18 SDRAM-Lasten. Alle Eingänge sind SSTL_18, mit Ausnahme der Reset(RESET)- und LVCMOS-Steuer(Cn)-Eingänge. Alle Ausgänge sind Edge-gesteuerte Schaltungen, die für DIMM-Lasten mit offenen Enden optimiert sind und die Anforderungen gemäß den SSTL_18-Spezifikationen erfüllen. Der SN74SSTU32864 von Texas Instruments wird von einem Differentialtaktgeber (CLK und CLK\) betrieben. Die Daten werden beim Übergang von CLK zu hoch und CLK\ zu niedrig registriert.