programmer CPLD - komplexe programmierbare Logikbausteine

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Menge RoHS ECAD Model Serie
Montageart
Verpackung/Gehäuse
Betriebsversorgungsspannung
Anzahl der Makrozellen
Anzahl der I/Os
Minimale Betriebstemperatur
Maximale Betriebsfrequenz
Maximale Betriebstemperatur
Verzögerungszeit - Max.
Qualifikation
Verpackung
Lattice CPLD - komplexe programmierbare Logikbausteine ispJTAG 3.3V 5ns 384MC 192 I/O
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 450
Mult.: 90

LC4384V SMD/SMT FTBGA-256 3.3 V 384 Macrocell 192 I/O 0 C 322 MHz + 90 C 5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 1’800
Mult.: 360

LC4064ZC SMD/SMT CSBGA-132 1.8 V 64 Macrocell 64 I/O - 40 C 250 MHz + 105 C 5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 1’250
Mult.: 1’250

LC4064ZC SMD/SMT TQFP-48 1.8 V 64 Macrocell 32 I/O 0 C 250 MHz + 90 C 5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 1
Mult.: 1

LC4064ZC SMD/SMT TQFP-100 1.8 V 64 Macrocell 64 I/O - 40 C 250 MHz + 105 C 5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 1’250
Mult.: 1’250

LC4064ZC SMD/SMT TQFP-48 1.8 V 64 Macrocell 32 I/O 0 C 250 MHz + 90 C 3.7 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 200
Mult.: 40

LC4256ZC SMD/SMT TQFP-176 1.8 V 256 Macrocell 128 I/O - 40 C 200 MHz + 130 C 7.5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 450
Mult.: 90

LC4128V SMD/SMT TQFP-100 3.3 V 128 Macrocell 64 I/O - 40 C 333 MHz + 105 C 5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 200
Mult.: 40

LC4256ZC SMD/SMT TQFP-176 1.8 V 256 Macrocell 128 I/O 0 C 200 MHz + 90 C 7.5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 1’800
Mult.: 360

LC4064ZC SMD/SMT CSBGA-56 1.8 V 64 Macrocell 32 I/O 0 C 250 MHz + 90 C 3.7 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 1’800
Mult.: 360

LC4064ZC SMD/SMT CSBGA-56 1.8 V 64 Macrocell 32 I/O - 40 C 250 MHz + 105 C 5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 1’800
Mult.: 360

LC4256ZC SMD/SMT CSBGA-132 1.8 V 256 Macrocell 96 I/O 0 C 200 MHz + 90 C 4.5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 1’800
Mult.: 360

LC4064ZC SMD/SMT CSBGA-132 1.8 V 64 Macrocell 64 I/O 0 C 250 MHz + 90 C 5 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 429
Mult.: 429

EPM240Z SMD/SMT BGA-100 1.8 V 192 Macrocell 80 I/O 0 C 152 MHz + 70 C 7.5 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 429
Mult.: 429

EPM570Z SMD/SMT BGA-100 1.8 V 440 Macrocell 76 I/O 0 C 152 MHz + 70 C 9 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 416
Mult.: 416

EPM570Z SMD/SMT BGA-144 1.8 V 440 Macrocell 116 I/O 0 C 152 MHz + 70 C 9 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 90
Mult.: 90

EPM1270 SMD/SMT FBGA-256 2.5 V, 3.3 V 980 Macrocell 212 I/O 0 C 304 MHz + 70 C 6.2 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 90
Mult.: 90

EPM1270 SMD/SMT FBGA-256 1.8 V 980 Macrocell 212 I/O 0 C 304 MHz + 70 C 6.2 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 180
Mult.: 60

EPM1270 SMD/SMT TQFP-144 1.8 V 980 Macrocell 116 I/O 0 C 304 MHz + 70 C 6.2 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 176
Mult.: 176

EPM570 SMD/SMT FBGA-100 2.5 V, 3.3 V 440 Macrocell 76 I/O - 40 C 304 MHz + 125 C 5.4 ns AEC-Q100 Tray
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 1’250
Mult.: 250

LC4032V SMD/SMT TQFP-48 3.3 V 32 Macrocell 32 I/O - 40 C 400 MHz + 130 C 2.5 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 1
Mult.: 1

EPM1270 SMD/SMT BGA-256 2.5 V, 3.3 V 980 Macrocell 212 I/O - 40 C 304 MHz + 85 C 6.2 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 1
Mult.: 1

EPM570 SMD/SMT FBGA-256 2.5 V, 3.3 V 440 Macrocell 160 I/O 0 C 304 MHz + 70 C 5.4 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 90
Mult.: 90

EPM570 SMD/SMT FBGA-256 1.8 V 440 Macrocell 160 I/O 0 C 304 MHz + 70 C 5.4 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 90
Mult.: 90

EPM570 SMD/SMT FBGA-256 1.8 V 440 Macrocell 160 I/O 0 C 304 MHz + 70 C 5.4 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 528
Mult.: 528

EPM570 SMD/SMT BGA-256 1.8 V 440 Macrocell 160 I/O - 40 C 304 MHz + 85 C 5.4 ns Tray