+ 125 C CPLD - komplexe programmierbare Logikbausteine

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Menge RoHS ECAD Model Serie
Montageart
Verpackung/Gehäuse
Betriebsversorgungsspannung
Anzahl der Makrozellen
Anzahl der I/Os
Minimale Betriebstemperatur
Maximale Betriebstemperatur
Maximale Betriebsfrequenz
Verzögerungszeit - Max.
Qualifikation
Verpackung
Lattice CPLD - komplexe programmierbare Logikbausteine Auto Grade (AEC-Q100 ) ispMACH4128Z
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 450
Mult.: 90

LA4128ZC-75TN SMD/SMT TQFP-100 1.8 V 128 Macrocell 64 I/O - 40 C + 125 C 168 MHz 7.5 ns AEC-Q100 Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 90
Mult.: 90

EPM1270 SMD/SMT FBGA-256 2.5 V, 3.3 V 980 Macrocell 212 I/O - 40 C + 125 C 304 MHz 6.2 ns AEC-Q100 Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 180
Mult.: 60

EPM1270 SMD/SMT TQFP-144 2.5 V, 3.3 V 980 Macrocell 116 I/O - 40 C + 125 C 304 MHz 6.2 ns AEC-Q100 Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 90
Mult.: 90

EPM2210 SMD/SMT FBGA-256 2.5 V, 3.3 V 1700 Macrocell 204 I/O - 40 C + 125 C 304 MHz 7 ns AEC-Q100 Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 84
Mult.: 84

EPM2210 SMD/SMT FBGA-324 2.5 V, 3.3 V 1700 Macrocell 272 I/O - 40 C + 125 C 304 MHz 7 ns AEC-Q100 Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 176
Mult.: 176

EPM570 SMD/SMT FBGA-100 2.5 V, 3.3 V 440 Macrocell 76 I/O - 40 C + 125 C 304 MHz 5.4 ns AEC-Q100 Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 180
Mult.: 60

EPM570 SMD/SMT TQFP-144 2.5 V, 3.3 V 440 Macrocell 116 I/O - 40 C + 125 C 304 MHz 5.4 ns AEC-Q100 Tray
Microchip Technology CPLD - komplexe programmierbare Logikbausteine 750 GATE EPLD 15NS
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 11 Wochen
Min.: 15
Mult.: 15
Nein
ATF750C Through Hole CDIP-24 5 V 10 Macrocell 10 I/O - 55 C + 125 C 90 MHz 10 ns Tube
Microchip Technology CPLD - komplexe programmierbare Logikbausteine 750 GATE EPLD 15NS
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 11 Wochen
Min.: 42
Mult.: 42
Nein
ATF750C SMD/SMT CLCC-28 5 V 10 Macrocell 10 I/O - 55 C + 125 C 71 MHz 15 ns Tube
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 1
Mult.: 1
Nein
EPM2210 SMD/SMT FBGA-256 2.5 V, 3.3 V 1700 Macrocell 204 I/O - 40 C + 125 C 304 MHz 7 ns AEC-Q100 Tray