- 40 C Tray CPLD - komplexe programmierbare Logikbausteine

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Menge RoHS ECAD Model Serie
Montageart
Verpackung/Gehäuse
Betriebsversorgungsspannung
Anzahl der Makrozellen
Anzahl der I/Os
Minimale Betriebstemperatur
Maximale Betriebstemperatur
Maximale Betriebsfrequenz
Verzögerungszeit - Max.
Qualifikation
Verpackung
Lattice CPLD - komplexe programmierbare Logikbausteine PROGRAMMABLE SUPER FAST HI DENSITY PLD
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 200
Mult.: 40

LC4384V SMD/SMT TQFP-176 3.3 V 384 Macrocell 128 I/O - 40 C + 105 C 322 MHz 5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine ispJTAG 3.3V 7.5ns 384MC 192 I/O
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 450
Mult.: 90

LC4384V SMD/SMT FTBGA-256 3.3 V 384 Macrocell 192 I/O - 40 C + 105 C 322 MHz 7.5 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine ispJTAG 3.3V 10nsIND 512MC 208 I/O
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 450
Mult.: 90

LC4512V SMD/SMT FTBGA-256 3.3 V 512 Macrocell 208 I/O - 40 C + 105 C 322 MHz 10 ns Tray
Lattice CPLD - komplexe programmierbare Logikbausteine ispJTAG 3.3V 5ns 512MC 208 I/O IND
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 40 Wochen
Min.: 450
Mult.: 90

LC4512V SMD/SMT FTBGA-256 3.3 V 512 Macrocell 208 I/O - 40 C + 105 C 322 MHz 5 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 1
Mult.: 1

MAX V 5M160Z SMD/SMT BGA-100 1.8 V 128 Macrocell 79 I/O - 40 C + 85 C 152 MHz 7.5 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 1
Mult.: 1

MAX V 5M80Z SMD/SMT BGA-64 1.8 V 64 Macrocell 30 I/O - 40 C + 85 C 152 MHz 7.5 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 90
Mult.: 90

EPM1270 SMD/SMT FBGA-256 2.5 V, 3.3 V 980 Macrocell 212 I/O - 40 C + 125 C 304 MHz 6.2 ns AEC-Q100 Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 90
Mult.: 90

EPM1270 SMD/SMT FBGA-256 1.8 V 980 Macrocell 212 I/O - 40 C + 85 C 304 MHz 6.2 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht auf Lager
Min.: 176
Mult.: 176

EPM1270 SMD/SMT BGA-256 1.8 V 980 Macrocell 212 I/O - 40 C + 85 C 304 MHz 6.2 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 180
Mult.: 60

EPM1270 SMD/SMT TQFP-144 1.8 V 980 Macrocell 116 I/O - 40 C + 85 C 304 MHz 6.2 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 1
Mult.: 1

EPM1270 SMD/SMT BGA-256 2.5 V, 3.3 V 980 Macrocell 212 I/O - 40 C + 85 C 304 MHz 6.2 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 180
Mult.: 60

EPM1270 SMD/SMT TQFP-144 2.5 V, 3.3 V 980 Macrocell 116 I/O - 40 C + 125 C 304 MHz 6.2 ns AEC-Q100 Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 90
Mult.: 90

EPM2210 SMD/SMT FBGA-256 2.5 V, 3.3 V 1700 Macrocell 204 I/O - 40 C + 125 C 304 MHz 7 ns AEC-Q100 Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 84
Mult.: 84

EPM2210 SMD/SMT FBGA-324 2.5 V, 3.3 V 1700 Macrocell 272 I/O - 40 C + 125 C 304 MHz 7 ns AEC-Q100 Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 1
Mult.: 1

EPM2210 SMD/SMT FBGA-324 2.5 V, 3.3 V 1700 Macrocell 272 I/O - 40 C + 85 C 304 MHz 7 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 1
Mult.: 1

EPM2210 SMD/SMT FBGA-256 1.8 V 1700 Macrocell 204 I/O - 40 C + 85 C 304 MHz 7 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 84
Mult.: 84

EPM2210 SMD/SMT FBGA-324 1.8 V 1700 Macrocell 272 I/O - 40 C + 85 C 304 MHz 7 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 176
Mult.: 176

EPM240 SMD/SMT FBGA-100 1.8 V 192 Macrocell 80 I/O - 40 C + 85 C 304 MHz 4.7 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 429
Mult.: 429

EPM240 SMD/SMT BGA-100 1.8 V 192 Macrocell 80 I/O - 40 C + 85 C 304 MHz 4.7 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 429
Mult.: 429

EPM240Z SMD/SMT BGA-100 1.8 V 192 Macrocell 80 I/O - 40 C + 85 C 152 MHz 7.5 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 640
Mult.: 640

EPM240Z SMD/SMT BGA-68 1.8 V 192 Macrocell 54 I/O - 40 C + 85 C 152 MHz 7.5 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 176
Mult.: 176

EPM570 SMD/SMT FBGA-100 2.5 V, 3.3 V 440 Macrocell 76 I/O - 40 C + 125 C 304 MHz 5.4 ns AEC-Q100 Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 1
Mult.: 1

EPM570 SMD/SMT FBGA-100 1.8 V 440 Macrocell 76 I/O - 40 C + 85 C 304 MHz 5.4 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 90
Mult.: 90

EPM570 SMD/SMT FBGA-256 1.8 V 440 Macrocell 160 I/O - 40 C + 85 C 304 MHz 5.4 ns Tray
Altera CPLD - komplexe programmierbare Logikbausteine
Datenblatt
Nicht-auf-Lager-Vorlaufzeit 39 Wochen
Min.: 429
Mult.: 429

EPM570 SMD/SMT BGA-100 1.8 V 440 Macrocell 76 I/O - 40 C + 85 C 304 MHz 5.4 ns Tray